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プレスリリース



「VR5500」の主な仕様

1. パイプライン 2命令同時実行可能なアウト・オブ・オーダー型スーパースケーラ・パイプライン
2. 命令セット MIPS命令に加え、整数積和演算命令、低消費電力命令などをサポート
3. 一次キャッシュ  命令キャッシュ:32KB。
2ウェイ・セット・アソシアティブ方式。
ラインロック機能をサポート
データキャッシュ:32KB。
2ウェイ・セット・アソシアティブ方式。
ラインロック機能/ノン・ブロッキング機能をサポート
4. 外部バス バスサイジング可能なアドレス・データ・バス(64/32ビット)
64ビット外部バス時:VR5000ファミリとバス互換
32ビット外部バス時:VR5000ファミリの32ビット版と互換
5. デバッグ機能 JTAG及び、N−wire、N−traceをサポート
6. 動作周波数 400MHz
7. 性能 804MIPS(400MHz動作時)
8. プロセス 0.13mCMOSプロセス
9. 電源電圧 1.5V(CPUコア)、3.3V(I/O)
10. パッケージ 272ピンABGA

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